“수율은 잡았는데, 성능은 TSMC 대비 열세”… 삼성 파운드리, 공정 고도화 총력

작성일 07-04

<div id="layerTranslateNotice" style="display:none;"></div>  <strong class="summary_view" data-translation="true">엔비디아·퀄컴 등과 2㎚ 공정 평가… 성능 개선 진척 더뎌<br>삼성전자, 1.4㎚ 공정 2027년에서 2029년으로 연기 전망</strong> 
        <div class="article_view" data-translation-body="true" data-tiara-layer="article_body" data-tiara-action-name="본문이미지확대_클릭"> 
         <section dmcf-sid="W6EQsByjn7">
          <figure class="figure_frm origin_fig" contents-hash="17152bb1cd2a7ca24921ba92e6738672de2781d44f1074048a25b0dc0b6e430e" dmcf-pid="YxrRC9Gkeu" dmcf-ptype="figure">
           <p class="link_figure"><img alt="삼성전자 평택캠퍼스 전경./뉴스1" class="thumb_g_article" data-org-src="https://t1.daumcdn.net/news/202507/04/chosunbiz/20250704060141084uvvc.jpg" data-org-width="2000" dmcf-mid="yAvaGx0CMz" dmcf-mtype="image" height="auto" src="https://img2.daumcdn.net/thumb/R658x0.q70/?fname=https://t1.daumcdn.net/news/202507/04/chosunbiz/20250704060141084uvvc.jpg" width="658"></p>
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            삼성전자 평택캠퍼스 전경./뉴스1
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          <p contents-hash="911da7be79d51a0e601ed3c03e9aa8c7d86ae4c6eff2eb835702a6f5c240531c" dmcf-pid="GMmeh2HELU" dmcf-ptype="general">삼성전자 파운드리(반도체 위탁생산) 사업부가 3㎚(나노미터·10억분의 1m) 이하 첨단 공정을 두고 테스트를 진행했던 빅테크 기업들과의 대량 수주 계약에 난항을 겪고 있다. 2㎚와 3㎚ 모두 공정 수율이 40%를 상회하면서 상용화가 가능한 수준으로 판단되고 있지만, 전력 대비 효율 등 칩 성능이 TSMC 등 경쟁사와 비교해 기대에 미치지 못하는 것으로 파악됐다. 당초 삼성전자는 엔비디아, 퀄컴 등과 2㎚ 공정을 두고 평가를 진행하고 있는 것으로 알려졌다.</p>
          <p contents-hash="9fced370851f9c533e4ee91c209479814a818c8586bb57e61dbdc0cbaab780f0" dmcf-pid="HRsdlVXDMp" dmcf-ptype="general">4일 업계에 따르면, 삼성전자 파운드리 사업부는 칩 성능을 개선할 수 있는 공정 고도화 방안을 마련하는 데 주력하고 있는 것을 알려졌다. 1㎚ 양산 시기를 2년가량 늦추고 3㎚ 이하 첨단 공정뿐만 아니라 기존 주력 공정의 성능 개선에 집중한다는 방침이다. 반도체 업계 관계자는 “엔비디아와 그래픽처리장치(GPU) 관련 성능 테스트를 진행하고 있지만, TSMC와 비교하면 진척이 더딘 상황”이라며 “퀄컴과 평가하고 있는 제품도 물량 규모가 크지 않아 수익성 개선에 도움이 될 수준은 아니다”라고 했다.</p>
          <p contents-hash="fdebbf2ef9f3976b554a92dbb0053f41cd18ecc809eed795198cc150dde747f2" dmcf-pid="XeOJSfZwL0" dmcf-ptype="general">당초 삼성전자가 계획했던 1.4㎚ 공정 도입은 오는 2027년에서 2029년으로 미뤄질 전망이다. 2㎚ 공정에서는 2㎚ 2세대(SF2P) 공정을 고도화하고, 전체 성능을 약 20% 이상 높인 3세대(SF2P+)를 내년 양산한다는 방침이다. 엔비디아와 AMD, 애플, 퀄컴 등 빅테크 기업 물량을 대거 수주한 TSMC와 달리, 삼성전자는 자사 시스템LSI 사업부의 애플리케이션 프로세서(AP)와 국내외 스타트업의 개발 물량 외에는 확보된 고객사가 없는 상황이다.</p>
          <p contents-hash="b5fe92de7d81c144b03937335e73ac0a294db1e6ff07e21935e45c5d25a3247e" dmcf-pid="ZdIiv45ri3" dmcf-ptype="general">4㎚ 공정도 전력 대비 효율 성능 등을 20%가량 높인 SF4U 공정을 바탕으로 물량 수주에 주력할 계획이다. 4㎚와 5㎚, 7㎚ 등 기존 공정도 TSMC와 비교하면 칩 성능이 저조하다는 평가를 받았다. 다만, 삼성전자는 공정 가격을 TSMC와 비교해 약 30% 저렴하게 책정하는 방식으로 대응하고 있다. 삼성전자의 해당 공정 수율도 70%를 웃돌고 있다. 하지만 TSMC가 3㎚ 이하 첨단 공정 시장을 장악하는 시점에 기존 공정 가격을 낮추면서 경쟁이 심화됐다.</p>
          <p contents-hash="0d1dfec5f59c3f340329e2527745d58de524af8d8e47d1338e5e739730e74a35" dmcf-pid="5JCnT81mRF" dmcf-ptype="general">중국 SMIC와 화홍반도체 등이 약 30% 저렴한 저가 공세를 펼치면서 차별화된 전략이 필요한 상황이다. 아직 중국 기업이 개발하지 못한 7㎚ 이하 공정에서 성능을 극대화해 수주 물량을 확보하겠다는 방침이다. 반도체 업계 관계자는 “4, 5㎚는 TSMC와 경쟁할 수 있는 수준으로 공정을 개선한다고 알고 있다. 아직 SMIC 등 중국 기업들이 개발하지 못한 공정이라 삼성전자가 물량을 수주하기에도 다소 유리한 편”이라며 “단기간에 적자 폭을 축소하는 데 기여할 수 있을 것으로 판단되고 있다”라고 설명했다.</p>
          <p contents-hash="a54e7128d5ac9d465cab47010879b95394023a0a2627cb45743a997d03d54b62" dmcf-pid="1ihLy6tsLt" dmcf-ptype="general">다만 1㎚대 공정 상용화가 지연되면서 차세대 공정 경쟁력이 뒤처질 수 있다는 우려가 나온다. TSMC는 1.6㎚ 공정을 내년 하반기 상용화할 방침인 것으로 전해졌다. 인텔도 삼성전자와 TSMC를 따라잡기 위해 1㎚급 공정에 주력할 계획인 것으로 전해졌다. 로이터는 2일(현지시각) “립부 탄 인텔 최고경영자(CEO)가 애플, 엔비디아 등 대형 고객사를 유치하기 위해 14A(1.4㎚) 공정에 집중하는 방안을 검토 중”이라고 보도했다.</p>
          <p contents-hash="c718716c5d85b10232ba445681b1a4d05b66258178c3fea73eaa6d3a77fd662a" dmcf-pid="tnloWPFOJ1" dmcf-ptype="general">- Copyright ⓒ 조선비즈 &amp; Chosun.com -</p>
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